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- 填空题 描述测试信号的变化和测试工程的模块叫做（）。
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- 填空题 （）仿真是布局布线后进行的后仿真，仿真时考虑了布线延时，和芯片实际的工作情况更加接近。
- 填空题 （）仿真是对综合后的网表进行的仿真，它验证设计模块的基本逻辑功能，但不带有布局布线后产生的时序信息，是理想情况下的验证。
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- 填空题 系统仿真分为（）、（）和（）。
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- 填空题 HDL综合器就是逻辑综合的过程，把可综合的VHDL/VerilogHDL转化成硬件电路时，包含了三个过程，分别是（）、（）、（）。
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- 填空题 将硬件描述语言转化为硬件电路的过程称为（）。
- 填空题 基于硬件描述语言的数字系统设计目前最常用的设计方法称为（）设计法。
